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Set up HDL verifier

2 visualizaciones (últimos 30 días)
Mohamed BAGHDADI
Mohamed BAGHDADI el 16 de En. de 2021
Respondida: YP el 21 de Nov. de 2022
how can i fix this problem?
PS: I work with MATLAB 2019b, Quartus Prime 18.1 & FPGA cyclone IV GX.

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Respuestas (1)

YP
YP el 21 de Nov. de 2022
The command line window shows "Expected programming file not generated".
You may need to check the project log see why the bit file gen failed.

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