Verificación de algoritmos en FPGA y ASIC

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El desarrollo de nuevos diseños de FPGA y ASIC conlleva implementar nuevos algoritmos, lo que plantea desafíos de verificación para los desarrolladores de algoritmos, diseñadores de hardware e ingenieros de verificación.

Con este e-book, aprenderá cómo afrontar los desafíos de verificación y reducir el esfuerzo invertido en desarrollo utilizando MATLAB^® y Simulink^® para:

Crear modelos de referencia de alto nivel
Utilizar modelos de referencia para la verificación de diseños
Probar la implementación de algoritmos en placas FPGA de desarrollo
Realizar diseño top-down y verificar diseños analógicos/de señal mixta
Adoptar los flujos de trabajo de certificación DO-254 e ISO 26262 para cumplir con los requisitos de seguridad funcional

Más información

HDL Verifier - Visión general
Verificación basada en modelos en el desarrollo de ASIC para automoción - Artículo

Introducción al desarrollo de FPGA, ASIC y SoC con MATLAB y Simulink

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